1.用一个always块描述FSM电路，也可以根据时序电路的组成框图用两个描述。
在时钟的有效沿到来前，可以根据电路 当前状态+输入决定的输出+次态，用一个always块描述。在时钟的
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Verilog描述FSM应注意的问题
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