阅读背景:

(筆記) initial的幾個特色 (SOC) (Verilog)

来源:互联网 

Abstract
雖然說RTL不會用到initial,但寫testbench時一定會用到initial。雖然說RTL不會用到initial,但寫testbench時一定會用到init




你的当前访问异常,请进行认证后继续阅读剩余内容。

分享到: