在学习别人的Verilog代码时，常常会遇到人家设置好的IP核，但是自己要用.v文件看，非常麻烦。百度了很多也没有满意的结果，最后终于找到了方法，现贴出来，希望可以解决很多跟我有同样困惑的同学在学习别人的Verilog代码时，常常会遇到人家设置好的IP核，但是自己要用.v文件看
阅读背景：
ISE中显示IP核的图形化界面
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